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微型熱敏打印機驅動器的時序控制方法

文檔序號:6334794閱讀:995來源:國知局
專利名稱:微型熱敏打印機驅動器的時序控制方法
微型熱敏打印機驅動器的時序控制方法
技術領域
本發明涉及一種微型熱敏打印機,尤其涉及一種微型熱敏打印機驅動器的時序控 制方法。
背景技術
在各類微型打印機控制方案中,一般以CPU模擬打印機馬達時序,這類方案用CPU 的IO 口模擬打印機馬達時序和送數據的時序,來實時的操作微型打印機。因此通常需要編 寫CPU的軟件程序,用定時器定時,以CPU的IO 口模擬打印時序。這種方法至少有以下幾 個方面的缺點1)這將耗費較多的CPU資源,受限CPU的處理能力,打印速度不快;2)安全性差,一旦CPU出現程序跑飛、死機等情況時,容易燒毀打印馬達,因此直 接由CPU控制的微型熱敏打印機驅動器必須帶有防CPU死機燒毀馬達的安全電路,但這會 導致成本增加。

發明內容本發明要解決的技術問題,在于提供一種微型熱敏打印機驅動器的時序控制方 法,由FPGA完成馬達的全部控制和數據的傳遞,降低了對CPU的要求,同時由于FPGA不存 在死機情況,來提升系統安全性。本發明是這樣實現的一種微型熱敏打印機驅動器的時序控制方法,其特征在于 在微型熱敏打印機驅動器的FPGA芯片設置一 CPU總線接口、一寄存器陣列和數據存儲區、 馬達伺服系統、數據傳輸控制電路、加熱控制電路,由所述CPU總線接口連接PC/微處理器, 所述時序控制方法包括如下步驟步驟10、PC/微處理器在打印開始前會從CB總線接收到打印機空閑中斷,在有打 印任務時,PC/微處理器通過地址總線和數據總線對打印機進行參數配置,并將待打印數據 傳輸給所述CPU總線接口 ;步驟20、所述CPU總線接口將這些參數和數據存儲到所述寄存器陣列和數據存儲 區,然后通知所述馬達伺服系統、數據傳輸控制電路以及加熱控制電路;然后同時進行步驟 30、40和50以進行打印動作步驟30、所述馬達伺服控制系統根據CPU總線接口的命令進行動作,以前向走紙、 退紙或者打印操作三個狀態進行;步驟40、所述數據傳輸控制電路根據馬達伺服系統所進行的狀態自動地將數據移 位給微型熱敏打印機;步驟50、所述加熱控制電路根據馬達伺服系統的狀態自動的進行加熱控制;步驟60、此時打印完成,之后馬達伺服系統向CPU總線接口發送空閑信息,CPU總 線接口將這個空閑信息轉換為打印機空閑中斷,發送給PC/微型處理器,以準備下次的數 據打印。
其中,所述CPU總線接口、寄存器陣列和數據存儲區、馬達伺服系統、數據傳輸控 制電路以及加熱控制電路是用VHDL語言編寫設置的硬件模塊。所述FPGA芯片可以為LATTICE公司的FPGA EPC1E1-3T144芯片。所述數據傳輸控制電路是根據CLK、DI和LAT的時序將數據移位到微型打印機的 自帶數據存儲器;所述馬達伺服系統通過一馬達時序控制圖和一馬達驅動時序表來控制馬 達驅動芯片的PA和PNA、PB和PNB進行走紙,并根據當前馬達的位置控制加熱控制端口 STB 進行加熱。本發明具有如下優點時序精確性好,可以精確的實現微型熱敏打印機馬達的時 序要求;安全性好,無死機的危險,能夠進行實時打印;靈活性好。能實現對多種品牌微型 熱敏打印機兼容,也可以根據不同種類的微型熱敏打印機,稍微改動下VHDL語言代碼,重 新綜合成下載數據流,下載到FPGA中即可使用;具備FPGA自身的一切優點如節約成本, 便于采購、存儲、質檢以及維護,便于升級。

下面參照附圖結合實施例對本發明作進一步的說明。圖1為本發明微型熱敏打印機驅動器實現示意圖。圖2為本發明方法流程框圖。圖3為三星熱敏微型打印機馬達時序控制圖。圖4為三星熱敏微型打印機馬達驅動時序表。
具體實施方式如圖1所示,為實現本發明的時序控制方法,可以在微型熱敏打印機驅動器的 FPGA芯片上用VHDL語言編寫設置一 CPU總線接口、一寄存器陣列和數據存儲區、馬達伺服 系統、數據傳輸控制電路、加熱控制電路,由所述CPU總線接口連接PC/微處理器,其中,所 述FPGA芯片可以為LATTICE公司的FPGA EPC1E1-3T144芯片。所述CPU總線接口 為一個與PC、ARM處理器進行接口的通用型接口,包括8位數 據總線DB [7:0]、8位地址總線AB [7:0]和3根控制總線CB [3 0];所述寄存器陣列和數據存儲區用來存儲CPU對整個系統的設置參數和需要打印 的數據;所述馬達伺服系統用以控制馬達的動作,并完成紙張在位檢測、前向走紙控制、 退紙控制;所述數據傳輸控制電路用以向熱敏打印機傳送串行數據,并控制數據何時進行 鎖存;所述加熱控制電路用以控制加熱的時序。再如圖2所示,基于上述基礎,本發明的時序控制方法包括如下步驟步驟10、PC/微處理器在打印開始前會從CB總線接收到打印機空閑中斷,在有打 印任務時,PC/微處理器通過地址總線和數據總線對打印機進行參數配置,并將待打印數據 傳輸給所述CPU總線接口 ;步驟20、所述CPU總線接口將這些參數和數據存儲到所述寄存器陣列和數據存儲區,然后通知所述馬達伺服系統、數據傳輸控制電路以及加熱控制電路;然后同時進行步驟 30、40和50以進行打印動作步驟30、所述馬達伺服控制系統根據CPU總線接口的命令進行動作,以前向走紙、 退紙或者打印操作三個狀態進行;步驟40、所述數據傳輸控制電路根據馬達伺服系統所進行的狀態自動地將數據移 位給微型熱敏打印機;步驟50、所述加熱控制電路根據馬達伺服系統的狀態自動的進行加熱控制;步驟60、此時打印完成,之后馬達伺服系統向CPU總線接口發送空閑信息,CPU總 線接口將這個空閑信息轉換為打印機空閑中斷,發送給CPU,以準備下次的數據打印。如圖3所示,本發明方法中所述數據傳輸控制電路是根據CLK、DI和LAT的時序將 數據移位到微型打印機的自帶數據存儲器;一般微型打印機在出廠時都會配有打印時序的 要求,不同的微型打印機打印時序會稍有不同,以三星熱敏打印機為例,圖3為三星熱敏打 印機的整體時序圖,圖4為三星熱敏打印機的馬達驅動時序。所述馬達伺服系統通過一如 圖3所示的馬達時序控制圖以及一如圖4所示的馬達驅動時序表來控制馬達驅動芯片的PA 和PNA、PB和PNB進行走紙,并根據當前馬達的位置控制加熱控制端口 STB進行加熱。若是 其他公司的熱敏打印機,其時序與三星熱敏打印機類似,稍微改動VHDL代碼即可實現。綜上所述,本發明具有如下優點時序精確性好,可以精確的實現微型熱敏打印機 馬達的時序要求;安全性好,無死機的危險,能夠進行實時打印;靈活性好。能實現對多種 品牌微型熱敏打印機兼容,也可以根據不同種類的微型熱敏打印機,稍微改動下VHDL語言 代碼,重新綜合成下載數據流,下載到FPGA中即可使用;具備FPGA自身的一切優點如節 約成本,便于采購、存儲、質檢以及維護,便于升級。
權利要求
一種微型熱敏打印機驅動器的時序控制方法,其特征在于在微型熱敏打印機驅動器的FPGA芯片設置一CPU總線接口、一寄存器陣列和數據存儲區、馬達伺服系統、數據傳輸控制電路、加熱控制電路,由所述CPU總線接口連接PC/微處理器,所述時序控制方法包括如下步驟步驟10、PC/微處理器在打印開始前會從CB總線接收到打印機空閑中斷,在有打印任務時,PC/微處理器通過地址總線和數據總線對打印機進行參數配置,并將待打印數據傳輸給所述CPU總線接口;步驟20、所述CPU總線接口將這些參數和數據存儲到所述寄存器陣列和數據存儲區,然后通知所述馬達伺服系統、數據傳輸控制電路以及加熱控制電路;然后同時進行步驟30、40和50以進行打印動作步驟30、所述馬達伺服控制系統根據CPU總線接口的命令進行動作,以前向走紙、退紙或者打印操作三個狀態進行;步驟40、所述數據傳輸控制電路根據馬達伺服系統所進行的狀態自動地將數據移位給微型熱敏打印機;步驟50、所述加熱控制電路根據馬達伺服系統的狀態自動的進行加熱控制;步驟60、此時打印完成,之后馬達伺服系統向CPU總線接口發送空閑信息,CPU總線接口將這個空閑信息轉換為打印機空閑中斷,發送給PC/微型處理器,以準備下次的數據打印。
2.根據權利要求1所述的微型熱敏打印機驅動器的時序控制方法,其特征在于所述 CPU總線接口、寄存器陣列和數據存儲區、馬達伺服系統、數據傳輸控制電路以及加熱控制 電路是用VHDL語言編寫設置的硬件模塊。
3.根據權利要求2所述的微型熱敏打印機驅動器的時序控制方法,其特征在于所述 FPGA 芯片為 LATTICE 公司的 FPGA EPC1E1-3T144 芯片。
4.根據權利要求2所述的微型熱敏打印機驅動器的時序控制方法,其特征在于所述 數據傳輸控制電路是根據CLK、DI和LAT的時序將數據移位到微型打印機的自帶數據存儲 器;所述馬達伺服系統通過一馬達時序控制圖和一馬達驅動時序表來控制馬達驅動芯片的 PA和PNA、PB和PNB進行走紙,并根據當前馬達的位置控制加熱控制端口 STB進行加熱。
全文摘要
本發明提供一種微型熱敏打印機驅動器的時序控制方法,在微型熱敏打印機驅動器的FPGA芯片設置一CPU總線接口、一寄存器陣列和數據存儲區、馬達伺服系統、數據傳輸控制電路、加熱控制電路,由所述CPU總線接口連接PC/微處理器,所述時序控制方法為PC/微處理器在打印開始前會從CB總線接收到打印機空閑中斷,在有打印任務時,對打印機進行參數配置,并將待打印數據傳輸給CPU總線接口;由CPU總線接口將其存儲到所述寄存器陣列和數據存儲區,然后通知所述馬達伺服系統、數據傳輸控制電路以及加熱控制電路同時進行打印動作。本發明方法由FPGA完成馬達的全部控制和數據的傳遞,降低了對CPU的要求,同時由于FPGA不存在死機的情況,提高了系統安全性。
文檔編號G06F13/10GK101980178SQ20101052696
公開日2011年2月23日 申請日期2010年11月1日 優先權日2010年11月1日
發明者劉文慶 申請人:福建鑫諾通訊技術有限公司
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